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锁相环（PLL）是现代通信系统的基本构件。 PLL通常用于无线电接收器或发射器中，并且主要提供“本地振荡器”（LO）功能。它们还可以用于时钟信号分配和降噪。越来越多地用作高采样率模数或数模转换的时钟源。

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随着每一代PLL的噪声性能的提高，电源噪声的影响变得越来越明显，在某些情况下甚至会限制噪声性能。今天，我们讨论图1所示的基本PLL方案，并检查每个构建模块的电源管理要求。

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图1。基本锁相环，显示了各种电源管理要求。许多出色的参考资料（例如Best的锁相环）说明了PLL的数学分析。 ADI的ADIsimPLL™等仿真工具有助于理解环路传递函数和计算。让我们依次看一下PLL构建块。 压控振荡器和压控振荡器将来自鉴相器的误差电压转换为输出频率。器件的“增益”定义为KVCO，通常以MHz / V表示。压控可变电容二极管（变容二极管）通常用于调整VCO内的频率。 VCO的增益通常足以提供足够的频率覆盖范围，但仍不足以降低相位噪声，因为任何变容二极管噪声都会被KVCO倍放大，从而增加输出相位噪声。

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多频带集成VCO的出现，例如频率合成器ADF4350的集成VCO，可以避免在KVCO和频率覆盖范围之间进行权衡，因此PLL设计人员可以使用具有多个中等增益VCO和智能频带切换的IC步骤根据编程的输出频率选择适当的频带。该频段划分可提供较宽的总体范围和低噪声。 除了需要从输入电压变化切换到输出频率变化（KVCO）之外，功率波动还可能导致干扰分量影响输出频率变化。 VCO对电源波动的敏感性定义为VCO推动（Kpushing），通常仅占所需KVCO的一小部分。例如，